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↳ ESP32-S3 双核下把 Wi-Fi 任务钉在 Core0、控制环钉在 Core1 的实测收益与踩坑

注意双核共享的PSRAM访问有争用，控制环若频繁读PSRAM会引入额外延迟，关键数据放内部SRAM，实测能再降5~10µs抖动。

2026-10-03

↳ STM32H7的DMA双缓冲模式在ADC连续采样中如何避免半传输中断丢数据

如果ADC是16bit、1Msps，半缓冲1024点只有0.5ms，中断里别用HAL_DMA_Start_IT这种重配置，直接双缓冲自动切换最稳。

2026-09-18

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